射频合成器由多个LC振荡器组成，这能将相位噪声减至很小，最小通道隔离度则可低至1MHz左右。由于整数N锁相环(PLL)的带宽至少要比参考频率小10倍，所以，它需要带宽很小的锁相环，只不过这类锁相环会增加通道切换时间(zappingtime)，并降低信道扫描速率。直接转换DBS调谐器通常使用分数N(fractional-N)锁相环，这能加快其稳定速度，并保留精密的频率分辨率，以提供相邻信道隔离能力。然而，分数N合成器通常更复杂，设计师必须仔细分析高阶Σ-Δ调制器回路可能造成的分数混叠信号(fractionalspur)和系统稳定等问题。

    由于锁相环的带宽较小，故需使用芯片外接的环路滤波器，这使得敏感的振荡器控制电路必须连接到电路板上的信号线。一般来说，独立调谐器可以通过适当的电路板设计来限制压控振荡器(VCO)的耦合噪声，电路板的混叠信号来源则包括交换式电源稳压器、石英振荡器辐射的参考单频(referencetone)和其它数字组件产生的单频信号。

    在使用SiP组件时，工程师必须仔细分析并设计所有的芯片接线，以便将数字解调器、LNA输入接线、频率合成器参考频率石英晶体接线、芯片外接锁相环滤波器接线和芯片内建LC振荡器电感之间的磁耦合减至最少。由于零中频调谐器会将射频信号直接降至基带，所以，不可能通过频率管理来避免某些混叠单频信号(spurioustone)。

    低中频宽带卫星调谐器

    SiliconLabs在2005年底推出了低中频DBS调谐器/解调器架构，它能避免1/f噪声对调谐器噪声指数的影响，并且消除信号路径的直流偏移。新架构采用高于1/f噪声转折频率的中频频率，避免了信号路径的大部分闪烁噪声(flickernoise)；另外，调谐器输出信号也不再包含直流电压。由于中频频率约为40MHz，耦合电容可以减少至数个pF，芯片内建电容能消除信号路径的任何直流偏移。

    在数字低中频调谐器设计中，模拟混频器会把一群L波段射频通道转换至低中频，然后进行滤波和转换，最后才在数字域里把信号降至基带；与采用模拟通道滤波的调谐器设计相比，这种方法可以提高滤波质量，并减少使用面积，所得到的数字低中频调谐器也很适合采用CMOS工艺。这种调谐器还能把解调器集成到同一芯片。

    Si2110低中频DBS卫星电视接收器会等到第二个数字混频器利用数值控制振荡器(NCO)把信号降至基带后，才在数字域执行最后的信道选择。电路接着会将QPSK基带信号解调，再通过芯片输出引脚提供所产生的MPEG传输流(transportstream)。这是理想的L波段射频至MPEG串流接收机单芯片方案，可以根据DVB-S或DirecTVDSSDBS标准接收卫星服务信息。

    低中频架构的技术优势

    与零中频架构相比，低中频调谐器的直流偏移消除回路会有较高的转折频率，故能在自动增益控制电路改变增益值后更快地稳定下来，这使得应用设计可以采用分立步进的自动增益控制电路。分立步进设计只需要电阻和开关组件，这与连续式自动增益控制电路有很大不同。这种无源式自动增益控制电路的噪声低于采用有源晶体管的衰减电路，线性特性也更优异，这有助于提高接收机的IIP3效能(Si2110在最大增益值时，IIP3=+25dBm，零中频DBS调谐器通常只有+9dBm)。